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时间:2025/7/16 0:15:26来源：https://blog.csdn.net/qq_27094347/article/details/145966863 浏览次数:1次

ZYNQ-PL学习实践（二）按键和定时器控制LED闪烁灯）

1 创建工程
2 verilog 代码
3 约束
4 综合
5 生成bit
总结

1 创建工程

在这里插入图片描述

2 verilog 代码

添加key_led.v 文件，

module key_led(input               sys_clk , //系统时钟50MHzinput               rst_n ,   //系统复位input        [1:0]  key ,    //两个按键输入output  reg  [1:0]  led     //；两个led 输出
);//寄存器定义
reg [24:0] cnt;                 //25位寄存器
reg        led_ctrl;            //500ms定时器溢出切换标志//定时器
always @ (posedge sys_clk or negedge rst_n) beginif(!rst_n)cnt <= 25'd0;             //定时器清零else if(cnt < 25'd2500_0000)  //定时未满500mscnt <= cnt + 1'b1;elsecnt <= 25'd0;            //定时满500ms
end//每隔500ms就更改LED溢出切换标志
always @ (posedge sys_clk or negedge rst_n) beginif(!rst_n)led_ctrl <= 1'b0;else if(cnt == 25'd2500_0000)led_ctrl <= ~led_ctrl;
end//以定时器状态和按键状态，控制两个LED的亮灭
always @ (posedge sys_clk or negedge rst_n) beginif(!rst_n)led <= 2'b11;else case(key)2'b10 :  //如果按键0按下、按键1未按下，则两个LED交替闪烁if(led_ctrl == 1'b0)led <= 2'b01;elseled <= 2'b10;2'b01 :  //如果按键0未按下、按键1按下，则两个LED同时亮灭交替if(led_ctrl == 1'b0)led <= 2'b11;elseled <= 2'b00;2'b11 :  //如果两个按键都未按下，则两个LED都保持点亮led <= 2'b11;default: ;endcase
endendmodule

3 约束

set_property -dict {PACKAGE_PIN Y9 IOSTANDARD LVCMOS33} [get_ports sys_clk]
set_property -dict {PACKAGE_PIN U18 IOSTANDARD LVCMOS33} [get_ports sys_clk]
set_property -dict {PACKAGE_PIN J15 IOSTANDARD LVCMOS33} [get_ports sys_rst_n]
set_property -dict {PACKAGE_PIN J21 IOSTANDARD LVCMOS33} [get_ports {key[0]}]
set_property -dict {PACKAGE_PIN L20 IOSTANDARD LVCMOS33} [get_ports key[0]]
set_property -dict {PACKAGE_PIN J20 IOSTANDARD LVCMOS33} [get_ports {key[1]}]
set_property -dict {PACKAGE_PIN A19 IOSTANDARD LVCMOS33} [get_ports {led[0]}]
set_property -dict {PACKAGE_PIN A18 IOSTANDARD LVCMOS33} [get_ports {led[1]}]set_property IOSTANDARD LVCMOS33 [get_ports rst_n]
set_property PACKAGE_PIN A17 [get_ports rst_n]